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2014-08-21T14:40:48Z

SA-1100

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[[ファイル:DEC StrongARM.jpg|thumb|right|DEC StrongARM SA-110 マイクロプロセッサ]]
'''StrongARM'''（ストロングアーム）は、[[ARMアーキテクチャ|ARM V4]] [[命令セット|命令セットアーキテクチャ]] (ISA) に基づいて[[デジタル・イクイップメント・コーポレーション|DEC]]が開発した[[マイクロプロセッサ]]ファミリである。後に[[インテル]]へ売却され、最終的には[[XScale]]に取って代わられた。

== 歴史 ==
StrongARMは [[ARMホールディングス|ARM]]と[[デジタル・イクイップメント・コーポレーション|DEC]]の共同プロジェクトとして、既存のARMシリーズよりも高速な[[CPU]](ただし完全互換ではない)を開発することから始まった。StrongARMは低消費電力の組み込み市場の中でも従来のARMシリーズでは性能が足りなかった[[ハイエンド]]市場を目指して設計された。ターゲットは[[携帯情報端末|PDA]]や[[セットトップボックス]]である<ref name="DTJ">Montanaro, James et al. (1997). [http://www.hpl.hp.com/hpjournal/dtj/vol9num1/vol9num1art5.pdf "A 160-MHz, 32-b, 0.5-W CMOS RISC Microprocessor"]. ''Digital Technical Journal'', vol. 9, no. 1. pp. 49–62.</ref><ref> {{Cite web| url = http://www.thefreelibrary.com/DIGITAL+TARGETS+SUPERCHARGED+StrongARM+CHIP+AT+CONSUMER+ELECTRONICS...-a017919435 | title = Digital targets supercharged StrongARM chip at consumer electronics market | accessdate = 2011-06-07 | date = 1996-02-05 | publisher = PR Newswire}}</ref>。

DECは[[マサチューセッツ州]]を[[半導体]]部門の拠点としていたが、[[シリコンバレー]]の才能ある人材を獲得しやすくするためカリフォルニア州[[パロアルト (カリフォルニア州)|パロアルト]]にデザインセンターを開設した。ここがStrongARMプロジェクトの拠点となった。また、DECから[[アップルインコーポレイテッド|アップル]]や[[モトローラ]]に一旦移籍して戻った技術者らが作ったテキサス州[[オースティン]]の設計拠点もプロジェクトに関わっている。プロジェクトは1995年に始まり、まもなく最初の設計である '''SA-110''' が完成した。

訴訟問題の結果として1997年、DECの StrongARM を含む半導体部門は後に[[インテル]]に売却された<ref>{{Cite web|url= http://news.cnet.com/2100-1023-204668.html|title=Intel, Digital settle suit|author=Erich Luening|date=1997-10-27|work= CNet news.com|accessdate=2008-07-29}}</ref>。インテルは不振だった同社の[[RISC]]プロセッサ([[Intel i860|i860]], [[Intel i960|i960]])の代わりにStrongARMを使った。2000年、その設計はインテルの[[XScale]]に取って代わられた。なお、そのXScaleも2006年に[[Marvell]]社に売却された。

DECの半導体部門がインテルに売却された際、パロアルトの技術者の多くは[[MIPSアーキテクチャ]]の通信向け [[System-on-a-chip]] (SoC) を設計していた[[ベンチャー]] SiByte（後に[[ブロードコム]]が買収）へ移籍した。オースティンの設計グループもMIPSの携帯機器向け SoC を設計するベンチャー Alchemy Semiconductor に参加した。

== SA-110 ==
SA-110は StrongARM ファミリの最初の[[マイクロプロセッサ]]である。当初 100MHz、160MHz、200MHz で動作するバージョンが1996年2月5日に発表された<ref>Digital Equipment Corporation (5 February 1996). "Digital Targets Supercharged StrongARM Chip At Consumer Electronics Market". Press release.</ref>。発表時点でサンプルが用意されていたが、量産品が出荷されたのは1996年中ごろである。より高速な166MHz版と233MHz版が1996年9月12日に発表された<ref>Digital Equipment Corporation (12 September 1996). "Digital's StrongARM Chips Pull Away in Embedded Race". Press release.</ref>。こちらも発表時点でサンプルが用意されており、量産品は1996年12月に出荷となった。1996年時点で、携帯機器向けマイクロプロセッサではSA-110が最高性能を誇っていた<ref>Turley, Jim (27 January 1997). "Embedded Vendors Seek Differentiation". ''Microprocessor Report'', pp. 16–21.</ref>。SA-110は[[アップル・ニュートン]]の後期に発表された'''メッセージパッド2000/2100'''で採用され<ref>Turley, Jim (18 November 1996). "Newton First Design Win for StrongARM". ''Microprocessor Report'', p. 5.</ref>、他にも[[エイコーン・コンピュータ|エイコーン]]社の[[Risc PC]]など多数の製品で使われた。SA-110は、[[:en:Daniel W. Dobberpuhl|Daniel W. Dobberpuhl]]、Gregory W. Hoeppner、Liam Madden、Richard T. Witek らが設計した<ref name="DTJ"/>。

=== 詳細 ===
SA-110の[[マイクロアーキテクチャ]]は単純である。[[スカラー計算機|スカラー]]設計であり、5段の典型的な[[命令パイプライン]]で命令を[[アウト・オブ・オーダー実行|イン・オーダー実行]]する。内部は、IBOX, EBOX, IMMU, DMMU, BIU, WB, PLL というブロックで構成されている。IBOXはパイプラインの最初の2段を処理するブロックで、命令をフェッチし、デコードし、発行する。命令フェッチは1段目で行われ、デコードと発行は2段目で行われる。ARM命令セットには単純に実行できない複雑な命令もあり、IBOXではそれを単純な命令の列に変換する。IBOXは分岐命令も扱う。SA-110には[[分岐予測]]機能はないが、分岐命令自体が高速に処理される。

命令の実行は3段目から開始される。このステージはEBOXで処理され、その中に[[レジスタファイル]]、[[演算論理装置|ALU]]、[[バレルシフタ]]、[[乗算器]]、条件処理ロジックなどが含まれる。レジスタファイルには3つのリードポートと2つのライトポートがある。ALUとバレルシフタは1サイクルで命令を実行する。乗算器はパイプライン化されておらず、実行には複数サイクルを要する。

IMMUとDMMUはそれぞれ、命令とデータの[[メモリ管理ユニット]]である。各MMUには32エントリのフルアソシアティブ[[トランスレーション・ルックアサイド・バッファ|TLB]]があり、1エントリで4KB、64KB、1MBのいずれかをマッピングできる（可変ページサイズ）。ライトバッファ (WB) は1エントリ16バイトで8エントリある。それによってストア動作をパイプライン化できる。バスインタフェースユニット (BIU) はSA-110と外部とのインタフェースである。

[[位相同期回路|PLL]]は外部から供給される3.68MHzのクロック信号から内部[[クロック]]信号を生成する。これはDECが設計したものではなく、スイスの[[ヌーシャテル]]にある Centre Suisse d'Electronique et de Microtechnique (CSEM) が設計を請け負った。

命令[[キャッシュメモリ|キャッシュ]]とデータキャッシュはそれぞれ16KBで、32ウェイ・セットアソシアティブで仮想インデックスである。StrongARMは遅い（それゆえに単純で安価な）メモリと使うことを念頭に設計されている。したがって、セットアソシアティブ数を高くすることでキャッシュヒット率を実現し、仮想インデックスにすることでキャッシュを通すメモリアクセスとキャッシュを通さないメモリアクセスを同時に扱えるようにしている。キャッシュはトランジスタ数を多く費やすため、ダイの半分をキャッシュで占めている。

SA-110は250万個のトランジスタを集積しており、大きさは 7.8mm×6.4mm (49.92mm2) である。DECがマサチューセッツ州ハドソンにある[[ファウンドリ|ファブ]]-6で、同社独自の CMOS-6 プロセスで製造した。CMOS-6 はDECの第6世代[[CMOS]]プロセスで、機能サイズ0.35μm、実効チャネル長0.25μmだが、SA-110ではアルミニウム配線層を3層しか使っていない。電源電圧は1.2Vから2.2Vの可変であり、電力消費量と性能のバランスを調整できるようになっている（電圧が高いほど高周波数で駆動できる）。パッケージは144ピンの薄型[[QFP]] (TQFP) である。

== SA-1100 ==
SA-1100はSA-110の派生品でDECが開発した。1997年発表。PDAをターゲットとしており、SA-110との違いはそういった市場にふさわしい機能を組み込んだ点である。データキャッシュの大きさは8KBに減らしている。

追加機能としては、メモリコントローラ、[[PCカード|PCMCIA]]コントローラ、カラーLCDコントローラをダイ上のシステムバスに接続する形で内蔵し、システムバスに接続した周辺バスにシリアルI/Oチャネルを5つ装備した。メモリコントローラは、[[FPM DRAM|FPM]]、[[EDO DRAM]]、[[Static Random Access Memory|SRAM]]、[[フラッシュメモリ]]、ROMをサポートしている。PCMCIAコントローラは2スロットをサポートしている。メモリアドレスおよびデータバスはPCMCIAインタフェースと共有される。シリアルI/Oチャネルはスレーブ側USBインタフェース、[[Synchronous Data Link Control|SDLC]]、[[UART]]×2、[[IrDA]]インタフェース、MCP、同期シリアルポートを実装している。

SA-1100には周辺チップであるSA-1101があり、インテルが1998年10月7日にリリースした<ref>Intel Corporation (7 October 1998). "Intel Introduces StrongARM Products for PC Companions". Press release.</ref>。SA-1101は、SA-1100に内蔵された周辺回路を補う周辺機能を提供するもので、ビデオ出力ポート、[[PS/2コネクタ|PS/2]]ポート×2、SA-1100上のものを置換するUSBコントローラとPCMCIAコントローラがある。このデバイスの設計はDECが始めたが、インテルが取得した際には完了しておらず、インテルが設計を引き継いで完成させた。DECから引き継いだハドソン工場で製造している。

SA-11000は250万個のトランジスタを集積し、大きさは8.24mm×9.12mm (75.15 mm2) である。0.35 μm CMOSプロセスで、アルミニウム配線層は3層であり、208ピンTQFPPでパッケージされている<ref name="ISSCC-1998>Stephany, R. et al. (1998). "A 200MHz 32b 0.5W CMOS RISC Microprocessor". ''ISSCC Digest of Technical Papers'', pp. 238–239, 443.</ref>。

== SA-1110 ==
SA-1110はSA-110からの派生品で、インテルが開発した。1999年3月31日、SA-1100の代替品として発表された<ref>Intel Corporation (31 March 1999). "Intel StrongARM Processor, Companion Chip Optimized For Handheld Computing Devices". Press release.</ref>。発表では、サンプル出荷を1999年6月、量産出荷を同年末としていた。SA-1110は2003年初めごろまで販売された<ref>Martyn Williams (14 February 2003). "Intel puts StrongArm on death row". InfoWorld.</ref>。133MHz版と206MHz版がある。SA-1100との違いは、66MHz（133MHz版）または103MHz（206MHz版）の[[SDRAM]]をサポートした点である。周辺チップとしてSA-1111もリリース。SA-1110は256ピンのMBGAでパッケージされている。携帯電話、PDA（コンパック [[iPAQ]]、HP Jornada、シャープ SL-5x00）、[[シンピュータ]]などに採用された。

== SA-1500 ==
SA-1500はSA-110の派生品で、DECが[[セットトップボックス]]向けに開発した<ref>Rick Boyd-Merrit; Peter Clarke (24 July 1998). [http://www.eetimes.com/news/98/1018news/strongarm.html "Intel to reveal details on StrongARM chip"]. EE Times.{{リンク切れ|date=2012年3月}}</ref><ref>Prashant P. Gandhi (18 August 1998). [http://www.hotchips.org/archives/hc10/3_Tue/HC10.S8/HC10.8.3.pdf "SA-1500: A 300 MHz RISC CPU with Attached Media Processor"]. Hot Chips 10.</ref>。DECが設計し少量だけ生産したが、インテルでは生産しなかった。200から300MHzで駆動できる。SA-110に対する改良点は、''Attached Media Processor'' (AMP) と呼ばれる[[コプロセッサ]]とSDRAMおよびI/Oバスのコントローラを内蔵した点である。SDRAMコントローラは100MHzのSDRAMをサポートし、I/Oコントローラは最高50MHzで動作する32ビットI/Oバスを実装し、各種周辺機器や周辺チップ SA-1501 を接続できる。

AMPはマルチメディア向けに設計された命令を実装しており、整数および浮動小数点数の[[積和演算]]や[[SIMD]]演算を行う。命令語長は64ビットで、演算命令以外に分岐命令やロード/ストア命令もある。36ビット64本のレジスタファイルと一連の制御レジスタがある。SA-110コアとはチップ上のバスでやりとりし、データキャッシュを共有している。AMPにはALU、シフタ、分岐ユニット、ロード/ストアユニット、積和ユニット、[[単精度]][[FPU]]が含まれる。また、AMPには書き換え可能な512エントリの[[コントロールストア]]があり、ユーザー定義命令をサポート可能である。

周辺チップのSA-1501は動画・音声処理機能とPS/2ポート、パラレルポートなど各種周辺機器を接続可能なI/O機能を有する。

SA-1500は330万個のトランジスタを集積しており、チップ面積は 60 mm2 である。0.28 µm CMOS プロセスで製造されている。内部ロジックは1.5から2.0Vで駆動し、I/Oは3.3V。消費電力は100MHzで0.5W、300MHzで2.5Wである。240ピン[[QFP|MQFP]]または256ピンPBGAでパッケージされている。

== 脚注・出典 ==
{{Reflist}}

== 参考文献 ==
* "StrongARM-1500 Grapples With MPEG-2". (8 December 1997). ''Microprocessor Report''.
* Halfhill, Tom R. (19 April 1999). "Intel Flexes StrongArm With New Chips". ''Microprocessor Report''.
* Litch, Tim; Slaton, Jeff (March/April) 1998). "StrongARMing Portable Communications". ''IEEE Micro''. pp. 48–55.
* Santhanam, S. et al. (November 1998). "A low-cost, 300-MHz, RISC CPU with attached media processor". ''IEEE Journal of Solid-State Circuits'', vol. 33, no. 11. pp. 1829–1839.
* Turley, Jim (13 November 1995). "StrongArm Punches Up ARM Performance". ''Microprocessor Report''.
* Turley, Jim (15 September 1997). "SA-1100 Puts PDA on a Chip". ''Microprocessor Report''.
* Witek, Rich; Montanaro, James (1996). "StrongARM: A high-performance ARM processor". ''Proceedings of COMPCON '96'', pp. 188–191.

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StrongARM - 版の履歴

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